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Compatível pino a pino com o produto AD2S44 da AD Company | 1 Classificação do produto |
Sincronizar Resolver M2S44SDC-61-115/11.8 M2S44SDC-412 | H2S44SDC-61-115/11.8 H2S44SDC-412 M2S44RDC-418 M2S44RDC-618 M2S44RDC-668 M2S44RDC-658 H2S44RDC-418 H2S44RDC-618 |
apresentam tamanhos pequenos, pesos leves, alta confiabilidade e alta | resistência anti-interferência etc. Série 2S44RDC/SDC são conversores de dois canais, os dois canais são independente, ou seja, os dois canais têm tensão de referência independente |
e sinal de entrada. Os dados de saída de 2S44RDC/SDC estão conectados a | barramento de dados por trava de saída de 14 bits. Os dois canais são comuns. o os canais são selecionados por duas linhas de controle: A/ e . 4 ESPECIFICAÇÕES TÉCNICAS (Aba 2, Aba 3) de 2S44RDC/SDC Série Dois Canais Conversores Synchro to Digital ou Resolver to Digital Converters Tabela 2 Condições nominais e condições operacionais recomendadas Valor nominal máximo absoluto |
Faixa de temperatura de armazenamento: -55~+125℃(H2S44) | -40~+105℃(M2S44) | Condições de trabalho recomendadas tensão de alimentação Vs: ± 15V tensão de referência (valor efetivo) Vref: 2~115V | tensão do sinal (valor efetivo) VI: 2~90V | |||
frequência de referência f: 50Hz~10kHz | faixa de temperatura operacional TA: -55~+125℃(H2S44) | |||||
-40~+85℃(M2S44) | Tabela 3 Características elétricas | Características | Condições | ×2S44RDC/SDC | ||
Padrão militar de negócios | 14 | — | (Q/HW30826-2006) | |||
Unidades | Mín. Máx. | Precisão — | — 0°~360° | V | ||
-5,3 5.3 Arco mín. Resolução | 20 — pedaço — | — 1 50 Saída | VoutHi VoutLo Hz Hz | |||
2.4 | 0,8 Velocidade de rastreamento | — Repetibilidade | Frequência de operação — | V | ||
Largura da banda 2,6 mil 100 Rev/s | LSB — — — | — entrada Vila VIHi | ns ns ns W | |||
)O isolamento diferencial interno converte os sinais de entrada do synchro (resolver) em sinais ortogonais:
)V2u003dKE 0 cosθsinωtOnde θ é o ângulo de entrada analógico.Os dois sinais são multiplicados por
)KE0 senθcosφsinωt –KE0 cosθsinφsinωtu003dKE0 sen(θ-φ)sinωtApós a ampliação do erro, a fasedemodulador e integrador, o sinal é inserido no VCO. Se θ-φ≠0,O VCO emitirá pulso, o contador ascendente/descendente contará até θ-φu003d0. No decorrerNeste processo, o conversor rastreia continuamente as mudanças do ângulo de entrada.(1) Função de transferência de canal único do conversorseleciona o canal B. Os dados se tornam válidos 640ns A/ é alternado. Cronometragem | informações são mostradas na fig. 4. |
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| (3) Habilitar saída ( é a entrada de habilitação de saída. Quando configurado para lógico “1”, DB1~DB14 estão no estado de alta impedância. Quando é definido como lógico “0”, DB1~DB14 representam o ângulo do transdutor | |
conversor. Os dados tornam-se válidos 640 ns após | é comutado. As informações de tempo são mostradas na fig.4. | Figura 4 Diagramas de tempo | (4) Teste integrado ( | é a saída de erro de teste integrada. Isso fornece um sinal de indicação de sobrevelocidade e falha para o canal selecionado via A/ | . |
A tensão de erro de cada canal é monitorada continuamente. Quando o 8 9 10 11 12 13 14 15 16 | erro excede ±50bits para o canal atualmente selecionado,
A/
for alto nível, os dados são inválidos. Em condições normais, é de baixo nível. é válido para o canal selecionado aproximadamente 50 ns após a mudança no estado de A/B. Condições que causam a para saída de alto nível. Isso significa que o conversor está no estado sem rastreamento. Resposta transiente de inicialização | Entrada de passo>1 grau Velocidade excessiva Falha de sinal Falha do conversor/sistema 6 DIAGRAMA MTBF (Fig. 5) de 2S44RDC/SDC Série de dois canais Sincronizador para Conversores Digitais ou Resolvedor para Conversores Digitais 7 CONFIGURAÇÕES DE PIN (Fig6, Tab4) da Série 2S44RDC/SDC Conversores Synchro to Digital de dois canais ou Resolver to Digital Conversores Figura 5 MTBF vs. temperatura Figura 6 Pinagem da vista inferior (Nota: De acordo com GJB/Z 299B-98, assumindo | 17 18 19 20 21 22 23 24 25 esse terreno está em boas condições) | Tabela 4 Descrição do pino Alfinete mnemônico Descrição Alfinete mnemônico Descrição 1~7 D8~D14 RLo(A) | RHi(A) S4(A) S3(A) S2(A) S1(A) Saída de dígitos Ativar saída Seleção de canal Detecção de erro Pino alto da entrada de referência do canal A |
Entrada de sinal do canal A Entrada de sinal do canal A | Entrada de sinal do canal A | 26~32 S1(B) | S2(B) | S3(B) S4(B) | RHi(B) |
RLo(B) | GND | 6 | -Vs | 11 | +V |
2 | D1~D7 | 7 | Entrada de sinal do canal B | 12 | Entrada de sinal do canal B |
3 | Entrada de sinal do canal B | 8 | Entrada de sinal do canal B | 13 | Pino alto de entrada de referência do canal B |
4 | Pino baixo de entrada de referência do canal B | 9 | Aterramento da fonte de alimentação | 14 | -fonte de alimentação de 15V |
5 | +15V fonte de alimentação | 10 | Saída de dígitos |
Peso (graus) | Pedaço | número | Peso (graus) Pedaço | número Peso (graus) | 1 (MSB) | 180.000 0 | 5.625 0 0,175 8 | 90.000 0 |
2.812 5 | 0,087 9 45.000 0 | Ni | 1.406 3 | Ni | 0,043 9 22.500 0 | Au | 0,703 1 |
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